数字电路上拉电阻 数字电路上拉电阻作用

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本文目录一览：

• 1、电路中为什么要上拉电阻和下拉电阻?
• 2、什么是上拉电阻，什么是下拉电阻
• 3、数字电路中问下图中上拉电阻的作用

电路中为什么要上拉电阻和下拉电阻?

上拉电阻和下拉电阻一般应用在数字电路的i/o端。

一般来说i/o端增加上拉电阻和下拉电阻有两个作用：

1、确认初始态。这个对于采用cmos工艺的数字电路尤其重要。因为如果不加上拉电阻或下拉电阻，当电路上电后，栅电压属于三态（可高可低），对内部电路初始态会造成影响。

2、增加上拉电阻或下拉电阻会对数字信号的沿造成影响。上拉电阻会减小数字信号上升沿时间，上拉电阻会减小数字信号下降沿时间。需要根据电路对沿的要求来匹配。

什么是上拉电阻，什么是下拉电阻

上拉电阻就是把引脚的电平拉高（往上拉），那电阻一端接在电源VCC上，另一端接在引脚上。

下拉电阻就是把引脚的电平拉低（往下拉），那电阻一端接在地GND上，另一端接在引脚上。

数字电路中问下图中上拉电阻的作用

三态门使能时输入时态传到输出，不使能时输出为高阻抗；又上拉电阻只存在中间三态门输出端，所以当该三态门不使能时其输出被上拉为高电平，使能时就按输入时态决定；另两个三态门不使能时输出都是被下拉为低电平。

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